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[招聘信息] 天数智芯实习招聘:虚位以待,“职”等你来

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发表于 2018-7-23 09:47:24 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式
本帖最后由 Emvampire 于 2018-7-24 17:31 编辑

鱼香肉丝里没鱼,我认了!老婆饼里没老婆,我也认了!雷峰塔里没雷锋,都情有可原!
但作为一个准毕业生,不来天数智芯实习,那就忍不了。
我们是一家由来自美国硅谷的计算机技术专家和国内行业精英联合创立的高科技创新企业,现已在南京、上海、硅谷、北京设有研发中心。公司创始团队主要来自世界知名芯片公司AMD的GPU部门和企业软件翘楚Oracle,Fujitsu。
来天数智芯实习,你将遇见更好的自己!
弹性工作时间,日薪最高200RMB,表现优异可转正。
更重要的是你将获得与AI专家、芯片设计领域大牛切磋和挑战自我的宝贵机会,在火热的芯片浪潮中乘风破浪不再是梦!
快来加入我们,成为国内首支通用、标准、高性能AI计算软硬件系统拓荒团的一名开拓者吧!
我们希望你:
即将大四或者研二,符合各岗位基本要求。
暑期实习,长期实习更佳,表现优异将有转正机会。
工作地点:上海浦东软件园祖冲之园Y2座202、203室(亮秀路112号)
待遇:本科150RMB/天;硕士 200RMB/天,另外还有丰富的下午茶,各式各样的team building等你来体验。
简历投递:
电话:18964123059 邮箱:mjshao@iluvatar.ai


岗位需求

一、ASIC Design
- Co-Work with World Wide Performance analysis and Design Team
1.Work with SW/HW team to analyze the benchmark/Game performance
2.Check/Optimize chip setting for better performance
3.Performance compare/analysis with the competitors’
4.Develop performance analysis/model tools for post-silicon workflow
5.Performance analysis for each rendering algorithm in game/benchmark
6.Research new GPU architecture to improve performance
7.Simulate rendering algorithm on RTL model to research performance issue on new GPU architecture
write demo performance case based on algorithm analysis result


二、Design Verification Intern
1.Intern for Digital ASIC Design/Verification 
2.The candidate is preferred to be MSEE(CS or EE) and should have:
3.Understanding basic ASIC design flow
4.With experience on Verilog or SystemVerilog
5.Master at least one language (Perl/Shell/Python/Ruby/Makefile/C/C++)


三、SW Intern:
1. Collaborate with HW team and system architectures to develop innovative Machine Learning Chip to extend the state of the art in deep learning performance and efficiency
2. Analyze and prototype key deep learning and data analytics algorithms and applications
3. Understand and analyze the interplay of hardware and software architectures on future algorithms and applications
4. Propose the direction of SW stack for machine learning, collaborating with architect, design and product teams


四、PD Intern:
1.  在校电子工程/微电子或相关专业在校大学生或在读研究生
2.  熟悉数字电路芯片设计流程和方法学,熟练使用verilog/system Verilog
3.  每周至少保证到岗工作3天及以上, 能承诺稳定保持四天以上到岗工作的优先。
4.  熟悉常用EDA tool,如ICC2, Calibre, Redhawk, PT, formal等优先
5.  具有良好脚本能力(如perl, tcl, python)优先
6.  有后端或者功耗分析相关经验者优先.


关于天数智芯



南京天数智芯科技有限公司(以下简称天数智芯)创立于2015年12月,是由来自美国硅谷的计算机技术专家和国内行业精英联合创立的高科技创新企业,现已在南京、上海、硅谷、北京设有研发中心。
天数智芯数十名创始团队主要来自世界知名芯片公司AMD的GPU部门和企业软件翘楚Oracle,Fujitsu。完整的芯片设计团队在芯片设计领域积累了近三十年经验,是一支国内最优秀、最完善的高端芯片设计队伍。
天数智芯沿袭了创始团队在打造面向企业信息化软硬件产品和云服务的基因,贴近用户和行业发展实际需求。在自有软硬件平台基础上,公司面向高端制造、轨道交通、医疗、教育、金融、互联网等行业,为客户提供面向云计算的智能数据平台方案SkyACC、软硬件一体机产品SkyAXE,和应用服务(SkyFront, SkyHealth, SkyEdu 和SkyFin)。
天数智芯秉承快速、持续、安全、快乐的发展理念,在聚焦和迭代中不断发挥长处。公司以造就“AI时代的芯魂合一”为愿景,立志成就中国高科技信息行业的知行合一。
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